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项目案例
基于FPGA的DDFS系统开发实现\FPGA代做\MATLAB代做
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产品说明:

DDFS的工作过程为:在参考时钟fc的作用下,相位累加器对频率控制字FCW进行线性累加,将其高W位作为地址码通过波形查值表ROM变换,产生D位对应信号波形的数字序列,再由数模转换器DAC将其转化为阶梯模拟电压波形后由具有内插作用的低通滤波器LPF将其平滑为连续的正弦波形作为输出。

相位截断是DDFS杂散的主要来源,即相位截断误差。DDFS的输出通常都是正弦信号,它的相位截断具有明显的周期性,尤其当系统时钟频率是输出正弦波频率的整数倍时,这种周期性更加明显。相当于周期性地引入了一个截断误差,最终的影响就是输出信号带有一定的谐波分量,表现在输出的频谱上,即输出带有杂散信号。

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